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试设计一个自然态序编码的同步七进制加法计数器.

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第1题
试用中规模同步十进制加法计数器CT74160,并附加必要的门电路,设计一个273进制计数器.

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第2题
用4位二进制加法计数器74161构成的计数器电路如图所示,则对该计数器应用电路功能描述正确的是()。

A.余3码编码的十进制加法计数器

B.循环码编码的九进制加法计数器

C.余3码编码的三进制加法计数器

D.循环码编码的二进制加法计数器

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第3题
设计一个6进制的同步计数器,需要()个触发器。

A.3

B.4

C.5

D.6

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第4题
试用两片4位二进制同步加法计数器CT74161及少量门电路构成100进制计数器.

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第5题
用JK触发器设计一个同步六进制加1计数器。

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第6题
试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.(根据二-十进制数的加法运算规则,当两数之和小于、等于9(1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9(即等于1010~111)时,则应在按二进制数相加的结果上加6(0110),这样就以给出进位信号,同时得到一个小于9的和.)
试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.(根据二-十进制数的加法运算规则,当两数之和小于、等于9(1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9(即等于1010~111)时,则应在按二进制数相加的结果上加6(0110),这样就以给出进位信号,同时得到一个小于9的和.)

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第7题
图P6.19是用两个同步十六进制计数器74163接成的计数电路。试分析整个电路是几进制计数电路。

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第8题
图P6.20是用两个同步十进制计数器74160组成的计数电路。试说明这个电路是几进制计数电路。进位输出
脉冲的宽度是时钟信号周期的几倍?

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第9题
图P5.18是由二进制优先权编码器CT74LS147(真值表参见表P5.18)和同步十进制加法计数器CT74160

图P5.18是由二进制优先权编码器CT74LS147(真值表参见表P5.18)和同步十进制加法计数器CT74160组成的可控分频器.试说明当输入控制信号分别为低电平,并假定CP脉冲的频率为f0时,由Z端输出的脉冲的频率是多少?

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第10题
给出下列器件: 74LS194、74LS169、74LS161、74LS151及少量门电路,试设计一个输出序列为01001100010111的序列信号发生器。(1)采用反馈移位型结构实现电路。(2)采用计数型结构实现电路。
给出下列器件: 74LS194、74LS169、74LS161、74LS151及少量门电路,试设计一个输出序列为01001100010111的序列信号发生器。(1)采用反馈移位型结构实现电路。(2)采用计数型结构实现电路。

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