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第3题
用集成3线—8线译码器74LS138和与非门设计一个全加器，设Ai为被加数，Bi为加数，低位进位为Ci－1，和为Si，向高位
用集成3线—8线译码器74LS138和与非门设计一个全加器，设Ai为被加数，Bi为加数，低位进位为Ci-1，和为Si，向高位进位为Ci。
第4题
集成3-8译码器74LS138逻辑图如图3.10所示,要求用此3-8译码器和适当的逻辑门（规定与非门)设计一
集成3-8译码器74LS138逻辑图如图3.10所示,要求用此3-8译码器和适当的逻辑门(规定与非门)设计一个全减器;设Ai为被减数,Bi为减数,低位向该位的借位为小差为Di向高位借位为Ji+1.
(1)列出全减器真值表;(2)写出函数逻辑表达式;(3)画出实现逻辑电路图.
第6题
数码管显示译码器实验中，要在数码管上显示d，右下角小数点点亮，seg[7:0]对应a~g~DP，seg的值应该是（)。
A.8’b01111010
B.8’b01111011
C.8’b11111101
D.8’b11111100
